Wynik wyszukiwania
Zapytanie: UKŁAD SYNCHRONICZNY
Liczba odnalezionych rekordów: 5



Przejście do opcji zmiany formatu | Wyświetlenie wyników w wersji do druku | Pobranie pliku do edytora | Przesłanie wyników do modułu analizy | excel | Nowe wyszukiwanie
1/5
Nr opisu: 0000120879
Synthesis of energy-efficient FSMs implemented in PLD circuits.
[Aut.]: R. Nawrot, Józef Kulisz, Dariusz Kania.
W: Proceedings of the International Conference of Computational Methods in Sciences and Engineering. ICCMSE 2017, Thessaloniki, Greece, 21-25 April 2017. Eds. T. E. Simos, T. Monovasilis, Z. Kalogiratou. Melville : American Institute of Physics, 2017, art. no. 120003, bibliogr. 16 poz. (AIP Conference Proceedings ; vol. 1906, iss. 1 0094-243X)

automat skończony ; niski układ zasilania ; PLD ; pobór mocy ; układ synchroniczny

finite state machine ; low power circuit ; PLD ; power dissipation ; synchronous circuit

2/5
Nr opisu: 0000112465   
Synthesis of energy-efficient counters implemented in PLD circuits.
[Aut.]: Józef Kulisz, R. Nawrot, Dariusz Kania.
W: Proceedings of the International Conference of Computational Methods in Sciences and Engineering. ICCMSE 2016, Athens, Greece, 17-20 March 2016. $Eds. Theodore E. Simos, Zacharoula Kalogiratou, Theodore Monovasilis. Melville : American Institute of Physics, 2016, 030006-1-030006-4, bibliogr. 17 poz. (AIP Conference Proceedings ; vol. 1790 0094-243X)

obwód niskiego zasilania ; pobór mocy ; układ synchroniczny ; automat skończony ; PLD

low power circuit ; power dissipation ; synchronous circuit ; finite state machine ; PLD

3/5
Nr opisu: 0000099501   
Kodowanie stanów energooszczędnych automatów sekwencyjnych wykorzystujące algorytm Kernighana-Lina.
[Aut.]: K. Kajstura, Dariusz Kania.
-Prz. Elektrot. 2015 R. 91 nr 5, s. 155-158, bibliogr. 14 poz.. Punktacja MNiSW 14.000

pobór mocy ; kodowanie stanów ; układ synchroniczny ; automat skończony

power dissipation ; state assignment ; synchronous circuit ; finite state machine

4/5
Nr opisu: 0000076481
Podstawy techniki cyfrowej. Przykłady zadań egzaminacyjnych.
[Aut.]: Tomasz Garbolino, Andrzej** Hławiczka, Józef Kulisz, Tomasz Rudnicki, Dariusz* Stachańczyk.
Gliwice : Wydaw. Politechniki Śląskiej, 2012, 334 s.
Skrypt nr 2505

układ cyfrowy ; układ kombinacyjny ; układ sekwencyjny ; układ asynchroniczny ; układ synchroniczny ; zadania

digital circuit ; combinational circuit ; sequential circuit ; asynchronous circuit ; synchronous circuit ; exercises

5/5
Nr opisu: 0000022618
Kodowanie stanów: minimalizacja liczby warstw z przekodowaniem.
[Aut.]: Robert Czerwiński, Dariusz Kania.
W: V Krajowa Konferencja Elektroniki, Darłówko Wschodnie, 12-14 czerwca 2006 r.. Warszawa : Wydaw. Czasopism i Książek Technicznych SIGMA-NOT, 2006, s. 26-28, bibliogr. 10 poz. (Elektronika ; R. 47, nr 11 0033-2089)

kodowanie stanów ; układ synchroniczny ; układ sekwencyjny ; pal ; CPLD

state assignment ; synchronous circuit ; sequential circuit ; PAL ; CPLD

stosując format:
Nowe wyszukiwanie